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Das D-FlipFlop 7474 bzw D174 oder DL074 Fr den Amateur gelegentlich von Bedeutung ist das D-FF (D vom engl. delay entspricht Verzgerung). Es ist als Typ D 174 erhltlich. Beim D-FF handelt es sich um ein flankengetriggertes FF mit einem Takteingang und einem Vorbereitungseingang. Der Takteingang wird mit cp bezeichnet, der Vorbereitungseingang mit D. Auerdem sind die bereits bekannten Setz- und Rckstelleingnge R und S sowie die Ausgnge Q und Q vorhanden. Bild 4. Frequenzteiler. 25a zeigt die innere logische Schaltung dieses FF, das aus mehreren intern verkoppelten RS-FF besteht und dessen Eigenschaften auf der Ausnutzung innerer Schaltverzgerungszeiten der einzelnen Gatter dieser IS beruhen. Im D 174 befinden sich 2 D-FF, die man unabhngig voneinander benutzen kann. Eine eingehende Funktionserluterung ist fr die Verwendung dieser IS nicht erforderlich. Deshalb wird im folgenden nur das Verhalten des D-FF beschrieben. Es handelt sich um ein flankengesteuertes FF, d. h., magebend ist nicht der Zustand des Signalpegels am Eingang cp, sondern die inneren Schaltvorgnge werden durch den Signalpegelwechsel am Eingang ausgelst.
Pegeländerungen oder einwirkende Störungen haben solange Einfluss, bis zum Zeitpunkt t3 die Eingangstore des Masters geschlossen werden. Eine Taktflankensteuerung kann mit dem viel kürzeren Taktpuls die Eingangstore eher schließen. Die Ausgangspegel des Masters sind jetzt gespeichert und bilden die Eingangssignale des folgenden Speicherwerks. Der zweite Speicher, als Slave bezeichnet, wird vom invertierten Eingangstakt gesteuert. Seine Eingangstore öffnen nach der fallenden Taktflanke und übernehmen zum Zeitpunkt t4 die vom Master anliegenden Informationen. Erst jetzt gelangt das Ergebnis der Eingangsdaten an die Ausgänge Q1 und Q2. Bei dynamischer Taktsteuerung sind nach Ablauf des Taktpulses die Eingangstore vom Slave gesperrt, sodass Störungen oder andere Datenpegel außerhalb der Taktflanken wirkungslos bleiben. D flip flop frequenzteiler 1. Bei der Taktpegelsteuerung bleiben die Eingänge vom Slave so lange störanfällig, bis die folgende positive Taktflanke zum Zweitpunkt t1 den Slave sperrt und vom Master trennt.
Der dritte Eingangstakt schaltet Q1 wieder nach H, und der vierte Eingangstakt (Q1= L) bewirkt, dass auch Q2 = L wird. Dieser HL-bergang an Q2 schaltet ber C6 Q3 = H. Nunmehr erhlt die Diode V 1 ber R3 katodenseitig positives, Potential, folgende Impulse knnen dieses Tor daher nicht mehr passieren, weil V 1 jetzt gesperrt ist. Der fnfte Takt setzt erneut Q1= H, der sechste Impuls Q1 = L (was wegen der jetzt gesperrten Diode V 1 auf den zweiten FF und Q2 keine Auswirkung hat! ) und zugleich setzt der beim sechsten Impuls an Q1 auftretende bergang HL. ber C7 auch Q3 = L, womit wieder der Ausgangszustand (alle Q = L) erreicht ist. D flip flop frequenzteiler youtube. Zu beachten ist dabei, dass mit dem vierten Eingangsimpuls Q2 von H nach L geht und dies ber C6 das Umschalten des dritten FF mit Q3 nach H bewirkt. Gleichzeitig tritt aber auch bei Q 1 ein HL-bergang auf, der ber C7 den gerade umgekehrten Zustand fr Q3 bewirken wrde. Aus diesem Grund wird C7 bei dieser Schaltung kleiner als die brigen C-Werte gemacht (Hinweis in Bild 4.
Bei 9 liegt zum Pulsanfang an J High Pegel und zum Pulsende an K ebenfalls High Pegel. Das JK-FF toggelt und wechselt zum Reset. An den Taktflanken 10 und 11 sind die Eingangspegel an J und K eindeutig unterscheidbar. Das Schaltzeichen eines JK-Master-Slave Flipflops entspricht dem des dynamischen JK-FF. Der Slave und die Invertierung seines Takts werden nicht dargestellt, dafür sind die Ausgänge mit den Winkelzeichen als retardierend gekennzeichnet. Die JK-Master-Slave Flipflops gibt es für High oder Low aktive dynamische Taktsteuerung. Sie können weitere vom Takt unabhängige, übergeordnete statische Steuereingänge für Preset, Clear oder Enable, der Taktfreigabe haben. Das Bild zeigt neben dem JK-Master-Slave noch die davon abgeleiteten D- und T-Master-Slave Flipflops. Das D-Master-Slave Flipflop kann mithilfe eines Inverters aus einem JK-Master-Slave-FF gebildet werden. D flip flop frequenzteiler size. Dazu wird der J-Eingang über den Inverter mit dem K-Eingang verbunden. Der J-Eingang wird als einziger Dateneingang zum D-Eingang.